cpu-architecture

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フェッチ、デコード、実行、および書き込みで構成された4ステージパイプラインのCPUで、各ステージには10,6,8、および8 nsそれぞれ、次のどれですか？平均命令実行時間はCPUのナノ秒（ns）ですか？ここで、実行されるべき命令の数は、十分に大きい（）。さらに、パイプライン処理のためのオーバーヘッドはごくわずかであり、すべての危険からのレイテンシの影響は無視されます。 A）6 B）8 C）10

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境界内のインクリメントまたはデクリメント

私はPythonを使用しているので、Pythonで例を挙げますが、質問はPythonに関するものではありません。変数を特定の値でインクリメントして、指定された境界にとどまるようにしたいとします。 def up (a, s, Bmax): r = a + s if r > Bmax : return Bmax else : return r def down (a

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分離されたタグ配列とデータ配列の組み合わせ

タグが通常どこに格納されているのでしょうか。私は、タグとデータが一緒に格納され、メモリアドレスを持つ一致するタグがあるときにデータ部分にアクセスする前にタグ部分だけがアクセスされるいくつかの結合されたタグデータキャッシュを見てきました。一方、私は分離された有効なビットと他のビットで完全に分離されたタグとデータキャッシュを見てきました。これらのアプローチのどれが一般的に使用されているのか、これら

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メモリマップI/Oは、メモリとI/O転送をどのように区別しますか？

これは、I/Oとメモリ転送に異なる制御線を使用することによって、「絶縁I/O」で転送がどのように区別されるかを示しています。しかし、どのようにして、同じ制御ラインを共有するメモリマップI/Oの転送を区別することができますか？現代のシステムがどのタイプのバスアーキテクチャを使用しているのかを知ることができます（今日のコアi3やそのプロセッサのようなもの）??? おかげ

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プログラムされたI/O転送でどのようにCPUが割り込み機能をサポートしていない場合にI/O操作を行うのかを知っていますか？

プログラムされたI/Oが割り込み機能をサポートしていない場合、CPUはI/O転送を実行するタイミングをどのように知るのですか？割り込みの概念がないため、I/Oがその命令を実行することを知らずにCPUが常にメモリ命令を実行し続けることを意味しません。割り込みがあった場合、CPUはI/O命令も実行することができます。お使いのシステムが割り込みをサポート、そして唯一のPIO（プログラムIO）がない場合、

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コンピュータの命令を表現するために必要なビット数はいくつですか？

コンピュータに65000ワードのメモリがある場合、53種類の命令（すべてが2つのアドレス）を持つコンピュータの命令を表現するのに必要なビット数はいくつですか？

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L1d CPUキャッシュタグはどこに格納されていますか？

私はWhat every programmer should know about memoryを読んでおり、というCPUキャッシュタグ（15ページ）という概念に苦しんでいます。私が正しく理解すれば、各CPUのキャッシュラインには、メインメモリ内のどのデータが対応するかを指定するタグがあります。つまり、特定の行に書き込む場合は、タグを使用して、RAMのどこにこの行の内容を書き込むべきかを調べます

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コンピュータアーキテクチャ命令宿題

これは単なる宿題なので詳細な回答は期待できません。私は皆の時間を無駄にしたくありません。 MIPSコードのようなものについて質問があります。我々は、命令有するメモリのメモリアーキテクチャである'M'機械有する： 'mmul.d a,b,c' bとcで64ビット浮動小数点値を取得し、メモリアドレスaに格納されています。今、私は'mmul.d a,b,c' を実装J-マシンのプログラムを記述する