riscv

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    クロックゲーティングは、電力削減のために重要です。チゼルのクロックゲーティングをどのように指定しますか? クロックゲーティングは、ロジック信号が特定のレジスタへのクロックがトグルされるかどうかを判断する場所です。論理信号が非アクティブの場合、クロックは安定したまま変化しません。イネーブルがアクティブのときのみ、クロック信号がトグルし、入力がフリップフロップにラッチされます。 バックエンドツールはこ

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    rocketchipアーキテクチャのmmベンチマークはどのような計算が行われているのかよくわかりません。このリンクには、mmの数字が入ります。 https://github.com/riscv/riscv-tests/tree/130702297a010b4a2e7452bb48f0da88c0b30aa9/benchmarks

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    BoyO、StackOverflowでこれらの人たちは本当にあなたがここで質問をしようとする前に考えていますか - この最初の質問を書いている実際の舞台の恐怖を持っています。 私は検索中に見つかったいくつかのリソースを提供しますが、最初にトピック自体について詳しく説明します。つまり、私はFloating Point Unitの研究に興味を持っていますので、利用可能なオープンソースのハードウェア実装

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    Windows 7-64bitプラットフォーム上で最新のGCC for RISCVでRISCV用の基本的なコンパイルを実行するのに問題があります。&インストール ツール:Windows 7の64ビット、ノーcygwinの プログラム: #include <stdint.h> int32_t iBlahblah; int main (void) { while(1) i

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    C++でRISC-Vアーキテクチャ(パイプラインプロセッサのISA)を実装する必要があります。すべてのISAが実装できないので、最も重要な約について私に教えてくれる人もいます。私が含めるべき指示セット40 助けてください

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    私はZスケールやCortex-M0のような原始的なシステムを探して研究プロジェクトを開始しています。 Z-scaleは廃止され、最新のRISC-V仕様に準拠していないようです。ロケットチップのCortex-M0のような、非常に原始的なコンポーネントと小さなフットプリント(ゲートカウントなど)を持つシステムを設計することは可能ですか? 私はRocket ChipのDefaultSmallConfig

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    私はRISC-Vに入っています。 私は、ソースコードリポジトリにダイビングしていますが、 私は多くのシミュレーション環境が存在することがわかりました。 しかし、ロゼットリポジトリのchisel3 RTLに由来するriscv-toolとC++シミュレータから派生したISAシミュレータが存在するのはなぜでしょうか。 これらのシミュレータの違いは何ですか?

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    Queueと他の標準ライブラリ・インタフェース・オブ・チゼル(​​、Validなど)の簡潔な定義は、Cheat-Sheetに、さらに詳細はChisel Manualにあります。私はまたStackOverflow - hereとhereでこれらの2つの答えを見つけました。 しかし、これらのリソースのどちらもプラスチックで説明されていません。これらのインターフェイスの目的を理解するのに役立ちます。実際

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    現在、私はRISC-Vを学習しており、RISC-Vツールチェーンを使用しています。私は、例を書いて、オペコードを見るためにコンパイルします。 例: #include <stdio.h> //float.c int main() { float a=1.04; printf("a=%f\n",a); return 0; } 私の手順は次のとおりです。 1. riscv64-unkn

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    整数除算例外に関する解説は、DIVの後にブランチを追加して、ゼロ除算のケースをチェックすることを示唆しています。すべての除数がレジスタに含まれているので、DIVの前に除数をチェックするほうが少し効率的です。最初にDIVを行うことがなぜ重要なのでしょうか?