axi4

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    MicroBlazeのデータバス例外については疑問があります。 MicroBlaze製品マニュアルには、キャッシュがオフになっているときにのみ例外がM_AXI_DCで発生すると記載されていますか?これは私には意味がありません。 M_AXI_DC行にエラー応答が与えられた場合、キャッシングが有効になっていれば例外は発生しません。私は現在C_DCACHE_ALWAYS_USEDを1に設定しているので、

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    位置バイトがAXI4-Streamingインターフェイスのコンテキストにどのようなものか説明できますか?私は、それがヌルバイトと同じではないが、スレーブに送信する必要はないということをどのように理解するのか分かりません。

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    私はアドバイスを探しています。私は現在、AXI4スレーブ入力とAXI4マスター出力を持つVHDLに統合されたカスタムIPを持っており、現在は信号が直接結びついています。 私は、AXI信号にカスタマイズ可能なレイテンシを追加したいので、お互いに接続するのではなく、IPを通じて特定の時間遅延させることができます。 私の質問は、 AxVALIDとAxREADY(たぶんRVALID/RREADYとWVAL