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私は50Hzの周りのカットオフ周波数、 Iドンを探していますのverilogを学んだし、FPGA内のローパスフィルタを実装する方法を思っていた、のVerilog（DE0ナノ）におけるローパスフィルタ
どのように/始めるべきかを知っている
誰かが私を始めるのを助けるために正しい方向に私を指摘できますか？
ありがとうございます。
A
答えて
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これまでにお試しいただいたことはありますか？
これはグーグルで簡単に答えている：
http://jason.sdsu.edu/~ashrafi/PDF/filters_FPGA.pdf http://file.scirp.org/pdf/CS_2015021515483091.pdf