2009-06-17 12 views

答えて

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opencores.orgを参照してください。

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からサンプルコンポーネントをフルアダーとして欲しいです。 はこのサイトです。ありがとうございました。 – alsadk

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opencores.orgライセンスのコードで、最終的なvhdlプロジェクトをオープンソースとして公開する必要があるかどうか知っていますか? – JeffV

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http://www.opencores.org/?do=faq ライセンスに移動します。 – alsadk

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また、http://www.freemodelfoundry.com/にはVHDLモジュールとVerilogモジュールがあります。ただ、私は右のそれをここに書くことができる全加算器のための

;)

entity full_adder is 
    port(
     a, b, cin: in BIT; 
     sum, cout: out BIT); 
end full_adder; 

architecture gate_level of full_adder is 
begin 
    sum <= (a xor b) xor cin; 
    cout <= ((a and b) or (a and cin)) or (b and cin); 
end gate_level; 

UPDATE:Aldec社のActive-HDLは、IPコア・ジェネレータを持っているようようなツール。異なるコア、入力パラメータを選択してすぐに使用できるVHDLまたはVerilogコンポーネントを取得できます。 Aldecは学生ライセンスを無料で提供しています。チェックアウトhttp://www.aldec.com/Company/University.aspx

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full_adderなどのコンポーネントを使用する準備ができました。 full_adderコードありがとうございます。 – alsadk

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Davidが言っているように、opencores.orgは良い出発点です。もう一つの興味深いプロジェクトは、LEON3プロセッサとそれに関連するGaislerライブラリです。オープンソースプロジェクトとしてはhttp://www.gaisler.com

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