instruction-set

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    コードインジェクション攻撃を避けるためにプロセッサが命令セットをランダム化する最近のプロセッサでは、instruction set randomizationについて読んでいます。実際、ウィキペディアの説明は私には分かりません。親切にも、誰かがそのプロセスを明確な方法で説明することができますか?キーが関わっていますか?

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    コンピュータに65000ワードのメモリがある場合、53種類の命令(すべてが2つのアドレス)を持つコンピュータの命令を表現するのに必要なビット数はいくつですか?

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    に従ってbit twiddling hacksウェブサイトによれば、操作 unsigned int a; // value to merge in non-masked bits unsigned int b; // value to merge in masked bits unsigned int mask; // 1 where bits from b should be selecte

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    私は人々がこれまでに似たような質問をしてきたことは知っていますが、本当に紛争している情報がたくさんあります。命令セットアーキテクチャ(ISA)と実際のハードウェア実装をはっきりと区別することによって、そうしようとします。まず私の未遂の明確化: 1)は現在intel64およびAMD64 CPUのうちは、とりわけ(そこにあるが、これらは焦点である) 2)ISAは、1つの以上のCPUのバイナリ表現である

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    MIPSでは、32ビットのジャンプ命令は、オペコードの6ビットとターゲット(宛先)アドレスの26ビットで構成されています私たちはプログラムカウンタを設定したいと思っています。 しかし、プログラムカウンタを28ビットのターゲットアドレスに設定することは可能です。ジャンプ命令に26ビットしか収まらない場合、これはどのように可能ですか?

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    MULU命令に関する質問があります。私が気づいたことの1つは、データレジスタに値000FFFFFがあるとします。そして00FFFFFFを含むように別のFを入れたいとします。 MULU #16, D4 そして、私は(私は00FFFFFFを取得する)命令を追加することによって、別のFを追加します。私は通常、やっていることはそうのように16でデータレジスタを掛けています。しかし、000FFFFFで再

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    浮動小数点命令を使用する関数の最適化に取り組んでいます。 ベンチマーキングでは、理論的に可能なパフォーマンスを知るために命令の実行レイテンシを知る必要があります。私はA53のためにそのようなドキュメントを見つけることができません、http://infocenter.arm.com/help/topic/com.arm.doc.uan0015b/Cortex_A57_Software_Optimiz

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    SPR(Special Purpose Register)の内容をグローバル変数に保存します。 私は議会で多くの経験を持っていないが、次のように私はそれを実行しようとしました: .global __The_Global_Variable mfspr r16, 695 #695 is the number of the SPR Register stw r16, __The_Global_V

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    ここでは、これを達成しようとしています。私のC++プロジェクトでは、はMicrosoft Visual Studio 2015以上でコンパイルする必要があります、私はいくつかのコードは、ユーザーのCPUで利用可能な最新のSIMD instrunctionに応じて異なるバージョンを持っている必要があります:SSE2SSE3 、SSSE3,SSE4.1,SSE4.2,AVX,AVX2およびAVX512

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    PUSHとPOPがRISCまたはCISCの指示であるかどうか、私はインタビューで尋ねられました。私は彼らがRISCだと言ったが、彼らは実際にはCISCの指示であると私に言った。私はARM(一般的なRISCの実装)にこれらの命令があることを示唆しましたが、ARMは純粋にRISCではなく混在していると指摘しました。 私は、一方的に、あるいは他の方法でオンラインで確かな証拠を見つけることができません。